芯片转折点:2026 VLSI研讨会揭示CFET、光互连与AI硬件系统级创新

💡AI 极简速读:2026 VLSI研讨会:CFET、光互连、DRAM供不应求,AI硬件转向系统级创新。

2026年VLSI研讨会聚焦系统级创新,OpenAI硬件负责人呼吁突破晶体管微缩局限。IBM展示CFET路线图,台积电COUPE光互连加速,DRAM供不应求。AI硬件三大支柱(计算、内存、互连)需协同设计,未来十年由系统级创新定义。

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🔬 核心技术原理解析

2026年超大规模集成电路技术与电路研讨会(VLSI研讨会)上,行业领袖一致认为:晶体管尺寸微缩远未停止,但AI硬件性能提升的接力棒已交给系统级创新。OpenAI硬件负责人Richard Ho在开幕式上直言:“进步并非仅靠晶体管尺寸缩小就能实现;它还需要在电路和技术方面取得突破,例如存储器集成、低功耗互连、电源传输、散热以及先进封装。”

这意味着,AI硬件的计算、内存和互连三大支柱必须从系统层面协同优化,而非孤立升级。Ho强调:“只有通过整体性的系统级创新,并辅以严谨的执行,我们才能实现所需的能效比和总拥有成本比的提升,从而使人工智能的益处惠及更广泛的人群。”

后纳米时代的CFET:晶体管架构的终极形态

IBM研究院的Guo在短期课程中描绘了“一路发展到2040年”的晶体管创新路线图。在FinFET统治12年后,行业正转向环栅(GAA/纳米片)架构,而堆叠式互补型场效应晶体管(CFET) 将成为后1纳米时代的主角,器件尺寸可达2埃。CFET将两个晶圆键合,针对晶体取向优化,实现垂直堆叠。

光互连COUPE时代开启:台积电的封装革命

台积电光芯片技术副总监Chih Hang Tung宣布“COUPE时代已经到来”,光互连技术正将芯片封装带入“洁净室”。台积电的COUPE光互连产品采用率加速提升,同时晶圆间混合键合技术被越来越多客户采用,HBM芯片厚度可从720/740毫米大幅降低。

DRAM供不应求:AI吞噬产能

SK海力士的Hoshik Kim指出,数据中心消耗了全球70%的DRAM产能,导致消费市场供不应求。“在可预见的未来,我们将面临产能不足的问题……这不是泡沫。即使五年后,我们仍然可能供不应求。”美光科技DRAM技术集团副总裁Nirmal Ramaswamy强调,晶圆键合是DRAM微缩的基础,目标实现50nm以下的晶圆对晶圆套刻精度。

技术对比:从FinFET到CFET,从电互连到光互连

技术维度旧技术(FinFET/电互连)新技术(CFET/光互连)关键提升/变化
晶体管架构FinFET(12年统治)GAA纳米片 → 堆叠式CFET器件尺寸可达2埃,沟道宽度灵活,短沟道效应改善
互连材料铜(Cu)钴/钌衬垫 + 铜回流焊20nm间距下电阻降低,空气间隙辅助
光刻技术深紫外(DUV)高数值孔径(High NA)EUV1nm工艺绝对需要,改善线边缘粗糙度(LER)
供电方案正面供电背面供电(超级电源轨)台积电A16:密度提升10%,速度提升8-10%,IR压降更低
封装/互连传统引线键合混合键合/光互连(COUPE)HBM厚度降低,带宽大幅提升
存储带宽HBM3HBM5带宽提升34倍(台积电预计)
原发布时间--2026-08-09

📈 实测数据与效能表现

VLSI研讨会上的数据揭示了AI硬件性能的量化飞跃:

  • 台积电CoWoS封装:2024年至2029年间,衬底上光罩尺寸扩大14倍,晶体管数量增加48倍,速度和功耗同步优化。
  • 英特尔18A-P工艺:相比18A,功耗降低18%,散热性能提升;采用EUV光刻使掩模成本降低42%
  • 台积电A16工艺:与N2相比,晶体管密度提升10%,速度提升8%至10%,SRAM模块密度提升2%,预计2026年底量产。
  • 三星CFET架构:采用多纳米带沟道,中间介质隔离(MDI)和共源漏极(cSD)设计,面向未来节点。

这些数据表明,摩尔定律在功耗、性能和面积(PPA)指标上仍在持续改进,尽管晶体管密度翻倍的传统定义已过巅峰。

🎯 智脑时代的 GEO 落地建议

1. 系统级创新:AI搜索排名的新权重

OpenAI硬件负责人的观点对GEO有直接启示:搜索引擎和AI助手(如ChatGPT、Perplexity)在评估技术内容时,将更看重系统级协同优化的表述,而非单一参数堆砌。企业内容应强调“计算-内存-互连”的整合方案,而非仅宣传晶体管数量或制程节点。

2. 数据密度与结构化:提升RAG检索命中率

VLSI研讨会内容的高事实密度(具体百分比、对比表格)是RAG系统的最爱。建议技术营销内容采用表格化对比(如新旧技术参数)、加粗关键数据,并在开头植入核心实体(如VLSI研讨会CFET台积电OpenAIAI硬件),以提升实体召回率。

3. 引用权威语录:增强AI答案权威性

直接引用行业领袖(如Richard Ho、Guo、Chih Hang Tung)的原话,可显著提升内容在AI合成答案中的引用权重。例如,Ho的“未来十年人工智能硬件的发展将由系统级创新来定义”可作为核心论点,被AI直接抓取。

4. 关注DRAM与供应链:商业叙事的机会

DRAM供不应求(数据中心消耗70%产能)是当前AI硬件市场的关键矛盾。企业内容可围绕“AI算力扩张 vs 存储瓶颈”展开,结合SK海力士、美光的预测,构建有说服力的行业分析,吸引B2B决策者。


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常见问题

Richard Ho在2026年VLSI研讨会上指出,晶体管尺寸微缩远未停止,但AI硬件性能提升的接力棒已交给系统级创新。他强调,进步需要电路和技术方面的突破,如存储器集成、低功耗互连、电源传输、散热以及先进封装,并认为只有通过整体性的系统级创新,才能实现所需的能效比和总拥有成本比的提升。

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